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研發類 - 數位IC設計工程師(MT000)

  • 全職

1.Create C-based models from given application algorithms and carry out simulations.
2.Plan top-level hardware architectures.
3.Implement the architectures with Verilog codes.
4.Verify the Verilog codes with the C-model simulation results.
5.Carry out hardware simulation with FPGA.
6.Analyze simulation results and optimize Verilog design.

工作條件

  • 工作經歷: 二年以上
  • 學歷要求: 碩士以上
  • 語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
  • 其它條件: 1.M.S. or Ph.D. in EE or equivalent, with solid knowledge of science and technology and strong motivation in innovative commercialization- oriented R&D.
    2.Familiar with IC design flow and FPFA verification methodology.
    3.2-year working experience in Verilog programming
    4.Familiar with function-based and system-based verification skills in digital IC design.
    5.Interested in digital IC design in ECC, NVM characterization, and AI.
    6.A good team player.
    7.Good communication skills in Chinese and English.

福利制度

【​具競爭力的整體薪酬待遇】
依營運狀況及個人績效,依公司規定發予季激勵獎金及提撥盈餘分配

【​貼心的福利制度】
生育、傷病、住院、急難、婚喪禮金補助
提供完善員工停車位,員工不須再為車位問題煩惱
舉辦家庭日活動,邀員工及眷屬同樂
提供預約式按摩舒壓服務
開辦暑/寒假兒童夏/冬令營
舉辦休閒聯誼活動,如健行、員工講座、電影欣賞及各類特別企劃活動
發放慶生禮券

【​完善的勞動制度】
遵守相關勞動法規、並善盡企業社會責任
提供同仁完善的保險規劃,含勞保,健保,團保,國外出差旅行平安險
男性同仁5天陪產假
免費定期員工健康檢查
駐診醫師及護士照顧同仁健康
設置孕婦哺乳室
按時提撥勞工退休金

更新日期:2021-12-06

應徵方式

  • 職務聯絡人: 招募任用部
  • 聯絡E-Mail: 未填寫 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽
  • 它: 1.請點選下方「我要應徵」 2.或請至旺宏電子網站登錄個人履歷表,網址:http://www.macronix.com/zh-tw/Careers/JoinUs/Pages/Job.aspx

應徵分析

兩週內0-5人應徵
經歷分佈
新鮮人0%
1~3年0%
3~5年50%
5~10年0%
10年以上50%
學歷分佈
碩士及以上50%
大學50%
專科0%
高中0%
高中以下0%
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