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Digital IC Designer

  • 全職

Maintain or design new IP function blocks based on architecture specification or new feature request.


工作條件

  • 接受身份: 上班族、外籍人士
  • 工作經歷: 三年以上
  • 學歷要求: 大學以上
  • 語文條件: 不拘
  • 其它條件: 1. Bachelor's degree in Electrical Engineering or Computer Science.
    2. Experience in digital IP design using Verilog or SystemVerilog.
    3. Solid design skills in synchronous design, asynchronous design, low-power design, and debugging.

    Preferred qualifications:
    1. Master's degree in Electrical Engineering or Computer Science.
    2. Experience with chip tapeout and mass production.
    3. Solid understanding of complete SoC design flow and design techniques and methods
    4. Experience in one or more of the following domains, is a plus
    - High-Level Synthesis using SystemC
    - Synopsys HAPS
    - CPU integration
    - Neural network

    Location: Hsinchu

福利制度

◆ 分紅/配股
1.員工認股
◆ 獎金/禮品類
1.年終獎金
◆ 休閒類
1.部門聚餐
2.運動日
◆ 制度類
1.員工制服
2.伙食費
3.績效獎金
◆ 請/休假制度
1.週休二日
2.特休/年假(優於勞基法之特休天數,到職即享10天特休)
3.不扣薪病假七天
◆ 其他
1.健康檢查

更新日期:2021-11-15

應徵方式

  • 職務聯絡人: Tiny
  • 聯絡E-Mail: (請利用104履歷表應徵此工作) 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
目前無資料
學歷分佈
目前無資料

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