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Sr. Analog Design Engineer/Manager

  • 全職


-Responsible for entire analog design implementation that covers design specification, design creation, integration and optimization to layout review, final post-layout simulation, silicon characterization and system test and debug.

-Experience in analog IP development that include ADC, DAC, Audio Codec, PLL, IO, memory, analog blocks and high speed PHY for 130nm, 90nm and below technologies.

-Knowledge in high speed PHY design (PCIE, USB, GbE, DDR) is an added advantage.

-Preferably done some test characterization, measurement and compliance in previous employment


1.Must have in-depth knowledge in circuit and logic IP design flow with hands-on experience in design and development, mixed signal design and simulation verification, IP test/characterization, low power high speed design methodology. Scripting in Perl, TCL, Unix, Linux
2.The ability to work with multiple team members
3.Working experience in EDA tools such as Synopsys Design Compiler, Physical Compiler, PrimeTime etc is a plus.

工作條件

  • 工作經歷: 三年以上
  • 學歷要求: 碩士以上
  • 語文條件: 不拘
  • 其它條件: 未填寫

福利制度

具競爭力的薪資水準
三節獎金(端午、中秋、春節)
依業績達成率發放季激勵獎金
生育、傷病、住院、急難、婚喪禮金補助
勞保、健保、眷保及團體保險(壽險、意外險、醫療險)、癌症保險。
提供同仁免費健康檢查
依據工作績效決定升遷, 調薪與利潤分享。
優秀員工表揚計畫
獎勵計劃
我們的成功來自於客戶的成功。因此,公司重視客戶導向的觀念,加強客戶服務與溝通上的能力,以滿足、甚至超越客戶的需求。
除了根據不同職類訂定個別的學習發展地圖, 實施必要的在職訓練之外, 鼓勵員工參加外訓課程,提供員工學習機會與資源。

更新日期:2021-11-29

應徵方式

  • 職務聯絡人: 黃小姐
  • 聯絡E-Mail: (請利用104履歷表應徵此工作) 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
新鮮人0%
1~3年0%
3~5年0%
5~10年0%
10年以上100%
學歷分佈
碩士及以上100%
大學0%
專科0%
高中0%
高中以下0%
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