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數位IC設計工程師 (Physical design engineer/ APR)

  • 全職

1) APR hierarchical design flow.

2) Physical design project execution.

3) Responsible for physical verification including DRC, LVS and ESD checking.

4) Static timing analysis by using Synopsys PrimeTime.

5) Work Assignments.

6) Interdepartmental communication and collaboration.

工作條件

  • 接受身份: 上班族、原住民【相關法令
  • 工作經歷: 不拘
  • 學歷要求: 碩士
  • 語文條件: 英文 -- 聽 /略懂、說 /略懂、讀 /略懂、寫 /略懂
  • 工作技能: IC版圖佈局佈線、撰寫IC電路佈局軟體
  • 其它條件: 1) Familiar with above program skills. (is a must)
    2) Familiar with Prime Time. (is a must)
    3) Familiar with Cadence INNOVUS or Synopsys ICC/ICC2. (is a must)
    4) 熟悉中文. (is a must)
    5) Good team player.
    6) Willing to learn.
    7) Problem analyzing and solving skills.
    8) Executing ultra-large scale SoC hierarchical physical design, in TOP level. (is a plus)
    9) Working on advanced node design methodology and sign-off experience. (is a plus)
    或有志於APR領域耕耘的新銳

福利制度

【獨家首創福利】
◆ 每年家庭特休假2日 (女友生日/小孩畢業要慶祝? 公司貼心提供家庭特休,讓你有餘力維繫家庭凝聚力!)
◆ 部門聯誼假1日

【優質生活保障】
◆ 14個月具競爭力薪資
◆ 績效獎金&營運分紅
◆ 團體意外險+醫療保險=雙重保障
◆ 員工健康檢查

【禮品禮金】
◆ 國內/外員工旅遊補助
◆ 三節創意禮品
◆ 生日禮券
◆ 結婚+生育禮金

【有益身心發展的工作環境】
◆ 成果展示區
◆ 崛智閱覽區
◆ 遊戲創意發想區
◆ 能量分享午茶區

【員工情感交流活動】
◆ 部門聚餐/公司聚餐
◆ Team building活動
◆ 慶生會
◆ 下午茶
◆ 生日點心

更新日期:2021-05-03

應徵方式

  • 職務聯絡人: HR
  • 聯絡E-Mail: (請利用104履歷表應徵此工作) 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
新鮮人0%
1~3年0%
3~5年100%
5~10年0%
10年以上0%
學歷分佈
碩士及以上100%
大學0%
專科0%
高中0%
高中以下0%

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