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Digital IC Design Engineer (Hsinchu)

  • 全職

1. Digital IC design, or verification, or FPGA, or STA timing closure. Algorithm,
DSP, Communication. SOC development flow, from architect, Specification,
design, verification, timing closure, tape out, mass-production.
Verilog and/or writing shell/tcl scripts.

2. Good sense of debug, meaning, identify the root cause, resolve the problem. Working with Design, Verification, FW teams. Positive thinking, good working attitude, team player.

工作條件

  • 接受身份: 上班族、應屆畢業生
  • 工作經歷: 不拘
  • 學歷要求: 大學以上
  • 語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
  • 其它條件: 未填寫

福利制度

法定項目

其他福利

◆ 獎金/禮品類
1.三節獎券/禮品
2. 專利獎金
3. 生日禮券
◆ 保險類
1.員工團保
2.眷屬團保
◆ 休閒類
1.每季部門聚餐
2.慶生會
3.員工旅遊
4. 每年定期舉辦員工健康檢查
◆ 制度類
1.伙食費
2.介紹獎金
◆ 請/休假制度
1.週休二日
2.優於勞基法特休/年假
3.不扣薪病假

更新日期:2021-09-13

應徵方式

  • 職務聯絡人: Joanne
  • 聯絡E-Mail: (請利用104履歷表應徵此工作) 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
新鮮人0%
1~3年100%
3~5年0%
5~10年0%
10年以上0%
學歷分佈
碩士及以上0%
大學100%
專科0%
高中0%
高中以下0%
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