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Sr. Digital IC Design Engineer (Taipei)(up to Sr. Staff)

  • 全職

1. Expertise in digital IC design, or verification, or FPGA, or STA timing closure.
(at least One of them).
2. Experience in SOC development flow, from architect, design, verification, timing closure, tape out, mass-production.
3. Experience of Verilog and/or writing shell/tcl scripts.
4. Good sense of debug, meaning, identify the root cause, resolve the problem.
5. Working with Design, Verification, FW teams.
6. International travel, technical on-site support, in USA or China is required.
( around 1 month per year)
7.Positive thinking, good working attitude, team player.

  • 職務類別: 數位IC設計工程師
  • 上班地點: 台北市內湖區
  • 上班時段: 日班  
  • 休假制度: 週休二日
  • 工作待遇: 待遇面議      查看市場薪資行情
  • 需求人數: 1至3人
  • 是否出差: 需出差,一年約3個月以下
  • 管理責任: 不需負擔管理責任
  • 可上班日: 一個月內

工作條件

  • 接受身份: 上班族
  • 工作經歷: 三年以上
  • 學歷要求: 大學以上
  • 語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
  • 其它條件: **Minimum Qualifications**
    1. Familiar with either one of PCIe, NVMe, SATA, DMA, DDR, ECC, NandFlash. Other protocols are fine
    2. You must have an open mind and willing to learn attitude.

福利制度

法定項目

其他福利

◆ 獎金/禮品類
1.三節獎券/禮品
2. 專利獎金
3. 生日禮券
◆ 保險類
1.員工團保
2.眷屬團保
◆ 休閒類
1.每季部門聚餐
2.慶生會
3.員工旅遊
4. 每年定期舉辦員工健康檢查
◆ 制度類
1.伙食費
2.介紹獎金
◆ 請/休假制度
1.週休二日
2.優於勞基法特休/年假
3.不扣薪病假

更新日期:2021-10-05

應徵方式

  • 職務聯絡人: Joanne
  • 聯絡E-Mail: (請利用104履歷表應徵此工作) 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
目前無資料
學歷分佈
目前無資料
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