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SoC Design Manager

  • 全職

※Job Contents:
1.Complete the front-end design tasks from RTL design to netlist.
2.Main job includes spec study, architecting, RTL coding, simulation, debugging, Lint, CDC, synthesis, LEC, SDC, and STA.
3.Support other functional teams (such as IP ,DFT , and P&R vendor) to deliver an SoC/ASIC.
4.Use communication and leadership skills to help the team to achieve the goal.
5. Porting RTL Code to FPGA Platform

工作條件

  • 接受身份: 上班族
  • 工作經歷: 五年以上
  • 學歷要求: 專科以上
  • 語文條件: 英文 -- 聽 /精通、說 /精通、讀 /精通、寫 /精通
  • 其它條件: ※Requirements:
    1.大學以上,電機/電子/資工相關科系畢
    2.Proven Industry experience over 5 years
    3.Familiar with CPU sub-system design/integration such as CPU, Bus Fabric, DDR, PCIe, MIPI and USB)
    4.Good at digital IC front-end design flow such as RTL design, Lint/CDC, Synthesis, LEC, STA
    5.Experience of analog IP integration such as PHY, Serdes and PLL
    6.Experience of IC backend design flow such as DFT,MBIST, P&R, post-silicon system level debugging
    7.Familiar with shell scripts for design automation such as Perl language
    8.Fluent in English communication

福利制度

【法定項目】
暫不提供

【其他福利】
暫不提供

1.人性化管理
2.員工紅利 : 依據公司獲利與個人績效發放
3.三節獎金/禮品:依據公司獲利與個人績效發放
4.勞保/健保/退休金提撥
5.週休二日
6.特休/年假
7.設置免費點心區

更新日期:2021-10-13

應徵方式

  • 職務聯絡人: Gavin
  • 聯絡E-Mail: (請利用104履歷表應徵此工作) 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
目前無資料
學歷分佈
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