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類比IC設計(資深)工程師(IP)

  • 全職

1. Strong Verilog-A skill: Modeling all kinds of analog circuits ( OSC, ADC, DAC, POR, Bandgap and etc …)
2. Basic analog circuit design: OSC, Bandgap, POR and etc
3. Collaborate with digital and system team to build the verification test chip and environment
4. Strong competence with various tools, Cadence analog simulation environmenet especially
5. Able to confidently share own expertise and work to others

工作條件

  • 接受身份: 上班族、應屆畢業生
  • 工作經歷: 不拘
  • 學歷要求: 碩士以上
  • 語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
  • 其它條件: 具3年以上記憶體macro電路設計, 懂process, 基本類比電路設計

福利制度

• 年薪14個月,並依據績效調薪
• 實施員工分紅制度
• 依照公司營運目標發給營運獎金
• 優於勞基法的休假制度
• 退休金提撥
• 人性化管理制度,彈性上下班
• 生日禮券,配偶生日禮券
• 三節禮券、結婚禮金、生育禮金、喪事奠儀
• 傷病慰問及急難救助
• 員工身心健康促進關懷方案 (定期健康檢查、視障按摩、EAPs…等福利)
• 高額國內外旅遊補助
• 福委會辦理各項文康、旅遊及家庭聯誼活動
• 語文課程、語文書籍、進修補助
• 員工休閒中心
• 員工餐廳及便利超商 (每月提供定額消費額度)
• 特約商店
• 發給休閒服及紀念品
• 尾牙聚餐摸彩
• 勞保、健保、團保 (同仁團保由公司負擔金額,眷屬亦可自費加入)
公司各項福利制度均比照 / 超越新竹科學園區同業

更新日期:2021-10-08

應徵方式

  • 職務聯絡人: HR
  • 聯絡E-Mail: (請利用104履歷表應徵此工作) 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
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學歷分佈
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