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JL - [知名美商/IC半導體公司] - 新竹Design Verification Engineer (UVM/ASIC) - 年薪100至200萬

  • 全職

【EE/HW人才歡迎投遞履歷留意相關外商機會】

重返榮耀! 什麼公司在疫情之下營收還能不斷創新高?
COVID-19雖然削弱了消費性電子市場的需求
財報收入表現亮眼超過市場預期

因內部Headcount關係, 若與主管&團隊面試後錄取後, 會先以約聘身份簽約
未來依工作表現與內部需求續聘或轉正, 先前人選都有陸續轉正
歡迎想要累積外商經驗的人選&想與業界專業菁英工作的您加入

故薪資結構為固定12個月, 無任何獎金, 到職享特休/彈性假
(例年薪180萬/12個月=15萬月薪)
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條件:
1.碩士學歷以上; EE或CE背景
2.期望至少5年的IC驗證經驗
3.熟悉UVM 驗證手法
通用驗證方法學(英語:Universal Verification Methodology, UVM)


EY RESPONSIBILITIES:
• Understand the architecture and algorithm of the ISP, responsible for verification deliveries for next generation of ISP
• IP sub-system verification for DMA, bus, embedded CPU, power and so on
• Develop UVM test bench on both block level and IP level for test
• Develop C++/SystemC model for simulation references
• Compose test plan, verification vectors, functional cover groups to ensure functional completeness
• Work with RTL designers and algorithm teams to close all possible issues during implementation
• Work on verification tasks on FPGA platforms and emulation platforms
• Work with global teams(Algorithm, design, firmware, software, tuning, SOC, DFT… ) to enable ISP solutions on productions.

PREFERRED EXPERIENCE:
• Familiar with ASIC Frond-End implementation flow and hands-on experiences in ASIC verification for at least 5 years
• Solid knowledge of SystemVerilog and UVM methodology
• Strong ASIC design knowledge to AMBA bus, DMA
• Good c/c++ programming skills is highly preferred
• Good knowledge of Unix/Linux, Makefile and scripts (TCL, Ruby, Perl, Python etc.)
• Experience with PHY, embedded core, low power verification would be strong advantage
• Experience with Image Signal Processing or multi-media IPs is a big plus
• Strong problem-solving skills, and attention to details
• Good interpersonal skills (verbal and written)
• A self-motivated team player

ACADEMIC CREDENTIALS:
• MS-EE / MS-CE with 5+ years directly related experience.

LOCATION :Hsinchu

工作條件

  • 接受身份: 上班族、研發替代役、原住民【相關法令】、二度就業
  • 工作經歷: 三年以上
  • 學歷要求: 大學以上
  • 語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
  • 工作技能: IC電路模擬測試、電子電路設計、數位晶片產品開發、數位電路分析設計、數位電路驗證
  • 其它條件: 未填寫

福利制度

[立可內部員工福利]
實質回饋你的優秀表現,立可提供最具吸引力的薪酬福利制度,認同你的成功與認真!
 「師徒制」的養成教育、良好的主管培育以及升遷制度
 每月個人績效獎金、每月團隊績效獎金、定期分紅制度
 每季於五星級飯店舉行「工作坊」並頒發Star Awards予優秀同仁(Workshop & STAR Award)
 定期與不定期部門聚餐(Dine and Wine)年度部門活動(Outing & Gathering)
 特殊貢獻獎金(Special Management Bonus)
 訓練補助與獎勵(Training Awards)
 海外分公司參訪(Overseas Orientation)

[企業代徵員工]
獎金及福利制度將依照各要派公司及各職務內容而有所不同。
欲知詳細內容,請洽立可顧問。

更新日期:2021-07-23

應徵方式

  • 職務聯絡人: Jimmy Liu
  • 聯絡E-Mail: 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
新鮮人0%
1~3年20%
3~5年0%
5~10年20%
10年以上40%
學歷分佈
碩士及以上20%
大學80%
專科0%
高中0%
高中以下0%
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