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Digital IC Design Engineer

  • 全職

Digital IC design, verification and physical implementation.
Synthesis, STA, timing closure.
FPGA integration.

[ Digital IC Desing Engineer - I ]
Experience in audio/voice signal processing (Filter, EQ, DRC.. ) is preferred.
Digital IP design and verification.

[ Digital IC Desing Engineer - II ]
SoC integration(floorplan design, package bonding) and verification
Power domain design.

  • 職務類別: 數位IC設計工程師
  • 上班地點: 新竹縣竹北市
  • 上班時段: 日班  9:00~18:00
  • 休假制度: 週休二日
  • 工作待遇: 待遇面議      查看市場薪資行情
  • 需求人數: 1至4人
  • 是否出差: 需出差,一年累積時間未定
  • 管理責任: 不需負擔管理責任
  • 可上班日: 不限

工作條件

  • 接受身份: 上班族
  • 工作經歷: 三年以上
  • 學歷要求: 大學以上
  • 語文條件: 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
  • 其它條件: Good knowledge of computer architecture, ASIC design flow, AMBA protocol (Familiar with AXI4-Lite is plus) and DV methodologies.
    Low power design techniques.

    Familiar with C, Verilog and IC design flow, digital IC design experience or FPGA use experience.
    Familiar with Verilog, synthesis, DFT, LEC, STA and FPGA verificaiton flow.
    Proficient with scripting language (perl/python).
    Ability to work well with others and share the belief that engineering is teamwork.

    Experience in any of the following is preferred:
    (1) Sigma-delta modulation and demodulation.
    (2) Interpolation/decimation filter or equalizer.
    (3) Sampling rate converter or auto level control.
    (4) Familiar with audio related processing is plus.

福利制度

〔兼顧工作與生活的平衡 / 保險制度〕
• 彈性上/下班時間:上/下班時間可根據個人安排調整  
• 家庭友善假:陪產假、育嬰假、家庭照顧假、女性同仁生理假等等
• 年假優於勞基法: 第一年就有等比例15天的年假
• 勞保、健保、勞退,給予更貼心的全面規劃
• 依勞基法規定健康檢查,提供員工完善的健康照護
• 專屬哺乳室

〔具競爭力的薪資制度〕
• 公司定期評估並提供優渥的薪資水準

〔舒適的工作環境及活動〕
• 提供開放舒適的辦公環境  
• 提供汽/機車車位
• 年度尾牙慶祝活動
• 咖啡無限暢飲

更新日期:2021-09-13

應徵方式

  • 職務聯絡人: Nina
  • 聯絡E-Mail: 我要應徵
  • 洽: 不接受電洽
  • 洽: 不接受親洽

應徵分析

兩週內0-5人應徵
經歷分佈
新鮮人0%
1~3年0%
3~5年0%
5~10年0%
10年以上100%
學歷分佈
碩士及以上0%
大學100%
專科0%
高中0%
高中以下0%
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