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1. 2 years of hardware design experience, including Ethernet switch, IAD, PC or Server, FPGA/CPLD embedded system.
2. Familiar with design tool of Orcad, PADs, Allegro, hyperlynx.
VHDL/Verilog with FPGA tool(Xilinx or Altera) is a plus.
3. Responsible for HW design on L2/L3 switch, PDH, SDH and PTN related product.
4. Basic communication skill in English is a plus.
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- 職務類別： 硬體研發工程師、硬體工程研發主管
- 上班地點： 新竹市新安路8號6樓(300)
- 上班時段：
日班 09:00~18:00 - 休假制度： 週休二日
- 工作待遇： 待遇面議 查看市場薪資行情
- 需求人數： 5人
- 是否出差： 無需出差
- 管理責任： 不需負擔管理責任
- 可上班日： 一個月內
日班 09:00~18:00 
工作條件
- 接受身份： 上班族
歡迎肢體障礙(下肢)(輕度)的身心障礙人士，需殘障手冊【相關法令】 - 工作經歷： 二年以上
- 學歷要求： 大學 碩士
- 語文條件： 英文 -- 聽 /中等、說 /中等、讀 /中等、寫 /中等
- 其它條件： 未填寫
福利制度
◆薪資制度
1.固定薪資十二個月
2.年節獎金兩個月
◆獎金
每個研發Project完成時，依員工績效決定Project獎金。如因市場急件需限時完成，也會依團隊績效表現決定Urgent Project獎金
◆員工分紅獎金
公司依獲利程度及員工績效表現決定員工分紅獎金
◆福利制度
1.暢通的晉升與轉職制度。例如：本公司有R/D、Lab、PLM、 FAE等部門，必要時員工可依自己的專長及興趣提出申請轉換部門
2.員工績效表現決定Project獎金
3享有工程師介紹獎金
4.週休二日，彈性上下班
5.國內外旅遊高額補助
6.享有年節禮券、婚喪喜慶津貼
7.享有部門同仁聚餐交際費
8.年終摸彩晚會及資深同仁贈金幣
9.員工社團活動(如游泳社、籃球社、羽球社、卡拉ok社、網球社、瑜珈社.......等)
更新日期：2021-02-19
應徵分析
兩週內0-5人應徵
經歷分佈
| 新鮮人 |   | 0% |
| 1~3年 | | 0% |
| 3~5年 | | 0% |
| 5~10年 | | 0% |
| 10年以上 | | 100% |
學歷分佈
| 碩士及以上 | | 100% |
| 大學 | | 0% |
| 專科 | | 0% |
| 高中 | | 0% |
| 高中以下 | | 0% |
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