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職務類別

數位IC設計工程師的工作機會

156 筆查詢結果
聯發科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
聯發科技持續深耕發展各類智慧裝置與應用的核心技術,已積極投入AI、車聯網、VR/AR 等深具潛力的的應用市場,維持業界領先地位。 因應前瞻的技術/產品/服務發展藍圖,近期正積極招募AI與多媒體(multimedia)相關領域專家。 如果您對AI on Chip與Computer Vision應用的無限可能有興趣,此刻正是加入聯發研發團隊的黃金時機! 【Algorithm & Architecture】 機器學習與電腦視覺演算法工程師 (AI) https://goo.gl/oLz9EN 【Ch
1天以前更新 兩週內大於30人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
Multi-RAT (6G/5G/4G/3G/2G) modem development. This is a common job description. You may involve at least one or more topics in the following: (1) architecture planning 1.1 Modem/SoC TOP system architecture 1.2 Modem/SoC CPU system design 1.3 Modem/SoC DSP system design 1.4 Modem/SoC BUS system design (2) digital circuit design and verification 2.1 baseband modules 2.2 digital front-end modules 2.
1天以前更新 兩週內大於30人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
1. 數位電路開發設計與整合 2. IP與系統層級驗證,包含FPGA和實際晶片 3. 數位流程執行與優化 4. IP文件與功能維護
1天以前更新 兩週內6-10人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
1. 負責Mobile/AI SoC平台軟體開發, 包括開機流程, 除錯系統, 記憶體管理/壓縮技術等。2. 負責IC平台韌體開發與相關IC模組驗證, 平台問題分析與解決 3. 系統架構與效能改善
1天以前更新 兩週內6-10人應徵
2021-09-17

Timing Sign-Off Expert

FULL_TIME
新竹市
聯發科技股份有限公司
  • 碩士
  • 二年以上工作經驗
  • 待遇面議
1 Develop the Timing signoff criterion and methodology to be applied during chip synthesis/APR/STA. 2 STA2SPICE correlation for new generation tming signoff methodology 3 Regression test for every signoff methodology by STA violation/slack analysys 4 Post-silicon data analysis for silicon-proven timing signoff criterion
1天以前更新 兩週內0-5人應徵
2021-09-17
聯發科技股份有限公司
  • 大學 碩士
  • 四年以上工作經驗
  • 待遇面議
- Logic/Physical Synthesis using advanced optimization techniques and generate optimized Gate Level Netlist for Timing, Area, Power. - Debug the timing/area/congestion issues and work with RTL & Physical designers to resolve them. - Perform Power Estimation at RTL and Gate Level and identify power reduction opportunities. - Run Formal Verification checks between RTL and Gate level netlist and debu
1天以前更新 兩週內0-5人應徵
2021-09-17
聯發科技股份有限公司
  • 大學以上
  • 工作經驗不拘
  • 待遇面議
1. Planning of millimeter-wave system technology and features 2. To define millimeter-wave system architectures and product specifications 3. Millimeter-wave system lead of internal projects 4. Work with customers for design-win 5. Work together with cross-nations teams 6. Collaborations with 3rd parties
1天以前更新 兩週內0-5人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士以上
  • 二年以上工作經驗
  • 待遇面議
1. 負責開發設計低功耗IP與產品, 需要設計軟韌體與驅動程式, IC驗證並協助客戶導入 2. 與硬體設計者, 系統應用端, 演算法同仁合作開發晶片從雛型設計到量產
1天以前更新 兩週內0-5人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
1) 開發針對本公司晶片設計所使用的EDA工具,工作內容包含:需求分析,演算法設計,資料處裡,與使用者介面設計 2) 推廣與嵌入新的流程到未來開案的晶片,目標是提升晶片開發的效率與品質 3) 透過設計演算法或以AI技術來定義與解決IC設計流程遇到的難題
1天以前更新 兩週內6-10人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
參與 5G New Radio 行動通訊數位基頻 IC 與 IP 開發. 包括multi-RATs (2/3/4/5G) modem的架構設計, RTL 設計, 整合和驗證.
1天以前更新 兩週內11-30人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
[2021年應屆碩士/博士畢業生適用,投遞履歷請附上大學/研究所成績單] 我們在找這樣的你: 資工/資管/電子/電機/電信/通訊/電控相關研究所背景,對行動通訊、無線及寛頻連結、家庭娛樂晶片解決方案有濃厚興趣的應屆畢業生。 勇於表達意見,以團隊成功為目標,面對困難不輕易放棄,總是在想更好的做法,擁有創新及不斷學習的精神。 聯發科技邀請您,與全球最頂尖的菁英一同合作,彼此激盪最新的創意與解法,共同挑戰每一個不可能。
1天以前更新 兩週內6-10人應徵
2021-09-17

GPU Integration engineer

FULL_TIME
新竹市
聯發科技股份有限公司
  • 碩士以上
  • 二年以上工作經驗
  • 待遇面議
1. Familiar with chip digital design flow, including RTL integration, simulation, STA, power analysis and post silicon debugging 2. Low power analysis, including pre-silicon power model creation and big data analysis 3. SoC architecture exploration and performance analysis experience is plus
1天以前更新 兩週內6-10人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士
  • 工作經驗不拘
  • 待遇面議
人工智慧處理器系統架構及RTL設計。 系統架構設計包含效能、功耗、頻寬、以及面積分析。並須負擔RTL實做及量產問題分析
1天以前更新 兩週內0-5人應徵
2021-09-17
聯發科技股份有限公司
  • 碩士
  • 工作經驗不拘
  • 待遇面議
1. 平台子系統設計(架構, RTL和整合) 2. 平台模組IP設計 3. On-chip連接結構設計 (如. AMBA, NOC) 4. 存取控制 (如. IOMMU, MPU, domain control) 5. Frame buffer基礎的壓縮設計 6. 系統記憶體頻寬評估與設計
1天以前更新 兩週內0-5人應徵
2021-09-17

數位驗證工程師

FULL_TIME
新竹市
聯發科技股份有限公司
  • 大學以上
  • 工作經驗不拘
  • 待遇面議
1. 充份了解待驗電路的規格 2. 決定驗證場景與訂定驗證計畫 3. 依據驗證需求使用可能的技術(如constrained-random verification, SystemVerilog UVM, SVA, power aware simulation 或是 formal equivalence checking)建立驗證所需的輸入與輸出的檢查 4. 執行並檢視驗證覆蓋率高低 5. 建立相關環境並執行regression simulation.
1天以前更新 兩週內0-5人應徵
2021-09-17
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