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數位IC設計工程師 CAD/CAM工程師 IC佈局工程師的工作機會

67 筆查詢結果

IC類比設計流程 CAD工程師

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新竹縣竹北市
聯詠科技股份有限公司
  • 碩士
  • 三年以上工作經驗
  • 待遇面議
1. 建置與強化聯詠類比設計流程 2. 評估與導入前瞻類比設計流程 3. IC類比設計流程自動化程式開發 【共創A+聯詠】 穩健踏實、專家精神、創造優勢 驅動科技、開發創新、引領未來 邀請優秀人才,共創A+聯詠
5天以前更新 兩週內0-5人應徵
2022-01-20
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【研發替代役/預聘】APR工程師 工作內容: 實体設計流程開發與實作 1. APR physical design, including floorplan, power plan, physical synthesis, clock tree, routing, DRC/LVS to tapeout 2. APR physical design methodology development & automation 【研發替代役/預聘】APR工程師 職務條件: 碩士以上電子、電機、電信、電控、資工等相關系所,並具下列任一條件者佳: 1. VLSI CAD實驗室學生 2. 具數位設計晶片
一週以前更新 兩週內0-5人應徵
2022-01-18
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【研發替代役/預聘】CAD工程師 工作內容: 1. 建置Front-end design flow 、Verification flow 、Sign-off flow、Power/IR flow 2. 建置及維護 Library flow、Analog & Mixed Signal 設計流程 3. 開發大型 EDA 程式 4. 開發先進製程的DFT流程 【研發替代役/預聘】CAD工程師 職務條件: 碩士以上電子、電機、電信、電控、資工等相關系所,並具下列任一條件者佳: 1. 熟 TCL or C/C++ or Perl 2. 具基本數位設計流程觀
一週以前更新 兩週內0-5人應徵
2022-01-18

Standard cell CAD engineer

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新竹縣竹北市
聯詠科技股份有限公司
  • 碩士
  • 三年以上工作經驗
  • 待遇面議
任職於Design Engineering Service (DES) 部門,主要負責Standard cell應用端效能最佳化分析。 1.Pre-layout/Post-layout PPA analysis 2.Standard cell design and layout optimization 3.Technical support of in-house & 3rd-party libraries。 4.需求條件: 4-1. 熟悉 physical design flow 4-2. 具備physical design PPA and routability 分析經驗尤佳 4-3. 具備high speed synthesis, DFT, or STA sign-off經驗尤佳 4-4.
一週以前更新 兩週內0-5人應徵
2022-01-18

【台南】數位IC設計工程師(A3)

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台南市永康區
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【產品線描述】 1. TCON embeded driver 2. pure source driver 3. LED driver 【工作說明】 1. 使用verilog硬體描述語言設計數位電路,並建立模擬環境 2. 與演算法開發者共同實現電路 3. 提供pattern給測試人員且共同除錯 4. 與SA共同合作完成FPGA驗證 【必要條件】 1. 熟悉Verilog HDL 2. 具有數位邏輯基礎概念
一週以前更新 兩週內6-10人應徵
2022-01-18
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【產品線描述】 Smart TV Solutions:提供TVSoC、MEMC/FRC及面板相關顯示裝置的控制晶片 ASIC Solutions:提供智能手機、智能電視、電競螢幕及商用顯示等產品各種ASIC解決方案 PD and Gaming Solutions:提供各種商用顯示及電競螢幕的控制晶片 【工作說明】 電視/手機/AR/VR 相關晶片,影像視訊相關演算法開發 1. MEMC,動態補償相關技術 2. EIS,電子防手震相關技術 3. VR/AR,虛擬/擴增實境相關技術 4. 神經網路相關技術 5. Gyro,陀
一週以前更新 兩週內6-10人應徵
2022-01-18

Layout流程 CAD工程師

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新竹縣竹北市
聯詠科技股份有限公司
  • 碩士以上
  • 三年以上工作經驗
  • 待遇面議
擔任CAD (Physical Verification Design) 主要工作內容: 1. 負責Layout tools & PV流程開發與維護 2. 負責Layout流程平台&自動化程式開發與維護 次要工作內容: 1. 負責DRC/LVS/LPE/PERC Command file撰寫與Maintain 2. 負責Physical PG Sign-off Check 4. 需求條件: 4-1. 碩士以上;電機、電機與控制、電信、電子、資工、資訊相關科系畢業為佳。 4-2. 需具備3年以上相關工作經驗。 4-3. 熟悉 TCL、SKILL、C/C++ or Perl/C-shell
一週以前更新 兩週內0-5人應徵
2022-01-18

【台南】APR Physical Design Engineer

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台南市永康區
聯詠科技股份有限公司
  • 大學 碩士
  • 工作經驗不拘
  • 待遇面議
1. APR physical design, including floorplan, power plan, physical synthesis, clock tree, routing, DRC/LVS to tapeout 2. APR physical design methodology development & automation 3.Requirement: 3-1. Familiar with ASIC design flow相關尤佳 3-2. Hands on APR physical design from netlist to DRC/LVS tapeout experience is required 3-3. Familiar with hierarchical and/or low power design flow相關
一週以前更新 兩週內11-30人應徵
2022-01-18
聯詠科技股份有限公司
  • 碩士以上
  • 一年以上工作經驗
  • 待遇面議
【產品線描述】 產品為車用顯示器驅動IC,主要有下列產品線 1. Bridge/TCON IC 2.TCON embeded source driver 3. pure source driver 3. LED driver 【工作說明】 1. 負責MCU與AMBA的系統架構設計與驗證 2.MCU周邊電路設計 3.IP設計開發(如DDR controller、提升效率的加速電路等) 【必要條件】 1. 熟悉Verilog HDL 2. 具有數位邏輯基礎概念
一週以前更新 兩週內6-10人應徵
2022-01-18
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【產品線描述】 行車及監控視訊相關產品 (CarDV, Surveillance relative video product) 【工作說明】 1. 影像處理演算法及ISP開發 (Digital Signal/Image Processing algorithm development) 2. 與IC designer合作完成演算法之硬體實作及驗證 (Co-work with IC designer for RTL implementaion and verification) 【必要條件】 1. 良好的溝通能力與團隊合作觀念, 快速的學習能力 2. 熟悉3A/Denoise/Sharpen/3DNR/HD
一週以前更新 兩週內6-10人應徵
2022-01-18
聯詠科技股份有限公司
  • 碩士以上
  • 三年以上工作經驗
  • 待遇面議
【工作說明】 1.SoC 架構設計及RTL實作 2.系統Bus與周邊controller設計 【必要條件】 1.熟悉FPGA開發流程以及驗證 2.熟悉IC設計後段流程,如synthesis/STA/LEC/DFT/…
一週以前更新 兩週內6-10人應徵
2022-01-18

【台南】IC佈局工程師

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台南市永康區
聯詠科技股份有限公司
  • 大學
  • 工作經驗不拘
  • 待遇面議
1.IC Analog / Digital Full Layout 2.需求條件: 熟悉Laker,具有ESD 觀念佳 【共創A+聯詠】 穩健踏實、專家精神、創造優勢 驅動科技、開發創新、引領未來 邀請優秀人才,共創A+聯詠
一週以前更新 兩週內11-30人應徵
2022-01-18

【台南】數位IC設計工程師 (I6)

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台南市永康區
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【工作說明】 1. SoC 晶片架構開發與系統匯流排設計。 2. SoC 晶片功能整合與相關模組設計品質確認。 3. AI加速器, 多媒體及影像資料處理功能開發, 設計與實現。 4. 高速資料傳輸界面功能開發與設計實現。 5. 先進製程的ASIC 前段實現流程執行與優化, 包含 synthesis, DFT, STA, LEC, PTPX 與APR團隊合作完成晶片時序收斂。 【必要條件】 1. 具備數位 IC 設計流程基礎 2. 熟悉 Verilog RTL coding /Simulation/Synthesis/STA/FPG
一週以前更新 兩週內0-5人應徵
2022-01-18

Standard cell design engineer

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新竹縣竹北市
聯詠科技股份有限公司
  • 碩士
  • 三年以上工作經驗
  • 待遇面議
任職於Design Engineering Service (DES) 部門,負責Standard cell設計及效能最佳化分析、In-house cell library開發、3rd party cell library維護。 1.Standard cell circuit design and optimization。 2.Library design methodology development。 3.Cell characterization and library generation。 4.Library QA and maintenance。 5.Technical support of in-house & 3rd-party libraries。 【共創A+聯詠】 穩健踏實、專
一週以前更新 兩週內0-5人應徵
2022-01-18
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【工作說明】 參與 SoC IC 開發,包含: 1. IP之開發、接收與驗證 2. IC系統規劃、整合與驗證 【必要條件】(符合下列一或多項者) 1. 對 SoC IC設計流程有實務經驗者佳 2. 具 USB Controller/PHY相關IC設計經驗者 3. 具 CPU Architecturing 與 Integrating 相關IC設計經驗者 4. 具 Memory card/Nand Flash controller 相關IC設計經驗者 5. 具 2D/3D Graphic相關IC設計經驗者 6. 具 Audio/Video CODEC 相關IC設計經驗者
一週以前更新 兩週內0-5人應徵
2022-01-18
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