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2453 筆查詢結果
智原科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
職務內容: Responsible for ASIC/SoC physical design (P&R) and physical verification. 職務條件: 1. 碩士以上,電子、電機、資訊工程相關系所畢業 2. 熟悉 CMOS 設計原理 3. 操作過 APR tool ( Innovus or ICC) 者為佳 4. 熟悉 TCL, C or Shell Language ※請同學附上履歷自傳、論文摘要/研究作品以及成績單。
一個月以前更新 兩週內0-5人應徵
2021-12-03
智原科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
職務內容: 1. APR flow development. 2. Develop methodology and construct flow for timing closure and clock tree quality. 3. CAD tool evaluation and consultant for physical design. 職務條件: 1. 碩士以上,電子、電機、資訊工程相關系所畢業 2. 熟悉 C or Tcl or Perl 3. 操作過 APR tool ( Innovus or ICC) 者為佳 ※請同學附上履歷自傳、論文摘要/研究作品以及成績單。
一個月以前更新 兩週內0-5人應徵
2021-12-03
創意電子股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
※Job Contents: 1.Responsible for physical design flow development including APR, SI, IR, CTS, timing closure methodology development, flow automation 2. Project support/execution & collaboration with EDA vendors 3. APR flow/scripts/environment development for advanced process nodes ※Requirements: 1.Experience in APR, hierarchical design flow 2.Experience in physical design project execution 3.Fam
3小時以前更新 兩週內0-5人應徵
2022-01-24
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【研發替代役/預聘】APR工程師 工作內容: 實体設計流程開發與實作 1. APR physical design, including floorplan, power plan, physical synthesis, clock tree, routing, DRC/LVS to tapeout 2. APR physical design methodology development & automation 【研發替代役/預聘】APR工程師 職務條件: 碩士以上電子、電機、電信、電控、資工等相關系所,並具下列任一條件者佳: 1. VLSI CAD實驗室學生 2. 具數位設計晶片
6天以前更新 兩週內0-5人應徵
2022-01-18
聯詠科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
【研發替代役/預聘】CAD工程師 工作內容: 1. 建置Front-end design flow 、Verification flow 、Sign-off flow、Power/IR flow 2. 建置及維護 Library flow、Analog & Mixed Signal 設計流程 3. 開發大型 EDA 程式 4. 開發先進製程的DFT流程 【研發替代役/預聘】CAD工程師 職務條件: 碩士以上電子、電機、電信、電控、資工等相關系所,並具下列任一條件者佳: 1. 熟 TCL or C/C++ or Perl 2. 具基本數位設計流程觀
6天以前更新 兩週內0-5人應徵
2022-01-18
安霸股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
1.VLSI Physical Design 2.Execute chip floorplanning, a variety of design closures on timing, signal integrity, power integrity, DFM as well as physical verifications. 3.Develop physical design flows/solutions on the cutting edge technology node.
4天以前更新 兩週內0-5人應徵
2022-01-20
NVIDIA_英屬維京群島商輝達維京股份有限公司台灣分公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
We are now looking for VLSI Physical Design Engineer (RDSS Intern) in Taiwan, Hsinchu Office.?We utilize latest process technology, advanced EDA tools, and sophisticated design methodology. We always work on the most challenging designs, and push for performance limit. What you will be doing: - Responsible for all aspects of physical design (Netlist to GDSII & Flow development) of all chips
一週以前更新 兩週內0-5人應徵
2022-01-12
安霸股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
1. Digital IP development and design spec/architecture documentation. 2. SoC system bus design. 3. SoC integration and design quality verification. 4. Mass production pattern development and debug. 5. IC development flow enhancement. 6. Team work for advanced SoC development.
4天以前更新 兩週內0-5人應徵
2022-01-20
智原科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
職務內容: 1. Responsible for the main technical contact window and consultant of chip implementation from RTL-in/netlist-in to tape out for ASIC customers 2. Responsible for ASIC project management and coordination among internal supporting groups 3. Responsible for DFT implementation, including MBIST, Scan insertion, IO level testing, JTAG and ATPG generation 4. Responsible for ASIC constraint va
一個月以前更新 兩週內0-5人應徵
2021-12-03
英屬蓋曼群島商譜瑞科技股份有限公司台灣分公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
-Master/PhD Degree in EE/CS or relevant -Solid knowledge of semiconductor logic design and flow. -Good understanding of video, computer and communications systems is a plus -It is a plus to be familiar with DisplayPort, HDMI, USB and PC Express or other communication protocols
4天以前更新 兩週內0-5人應徵
2022-01-20
英屬蓋曼群島商譜瑞科技股份有限公司台灣分公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
-Solid integrated circuit and solid state devices knowledge -Familiar with circuit design EDA tools -Knowledges in the following areas are a plus:  PLL, high speed circuit design, I/O design, LVDS, ESD, ADC/DAC, switching regulator, low noise design
4天以前更新 兩週內0-5人應徵
2022-01-20
智原科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
職務內容: 1. Front-end design flow development 2. Logic Synthesis, STA, LEC, ECO flow creation and consultant 職務條件: 1. 碩士以上,電子、電機、資訊工程相關系所畢業 2. Familiar with script language (ex.,C/C++, TCL, Perl) 3. Experience of use SoC design timing analysis, logic synthesis is a plus ※請同學附上履歷自傳、論文摘要/研究作品以及成績單。
一個月以前更新 兩週內0-5人應徵
2021-12-03
創意電子股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
(一)工作內容: 1. Ramp up high-speed interface protocol, execute test plan 2. In charge of Subsystem DV for SPEC-IN Project 3. In charge of Emulation flow 4. Functional verification with Palladium Z1 ※工作地點為新竹。 (二)需求條件: 1.Degree in EE or CS Engineering, MS required 2.Excellent analytical and problem solving skills ※請同學附上論文/研究作品和成績單。
3小時以前更新 兩週內0-5人應徵
2022-01-24
智原科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
職務內容: Responsible for the development and implementation for advanced at speed testing and other DFT, JTAG, memory bist, scan chain and ATPG, for ASIC projects. 職務條件: 1. 碩士以上,電子、電機、資訊工程相關系所畢業 2. 熟悉 DFT概念及EDA Tool者為佳 3. 熟悉 Logic Design or Verilog Language ※請同學附上履歷自傳、論文摘要/研究作品以及成績單。
一個月以前更新 兩週內0-5人應徵
2021-12-03
智原科技股份有限公司
  • 碩士以上
  • 工作經驗不拘
  • 待遇面議
職務內容: 1. Study / research / develop DFT design flow 2. Maintain inhouse DFT utilities. 職務條件: 1. 碩士以上,電子、電機、資訊工程相關系所畢業 2. 熟悉 DFT概念及EDA Tool者為佳 3. 熟悉 C/C++ or Tcl ※請同學附上履歷自傳、論文摘要/研究作品以及成績單。
一個月以前更新 兩週內0-5人應徵
2021-12-03
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