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3/28 儲備數位 IC 研發工程師【2024校園徵才|歡迎應屆畢業生及新鮮人】

  • 新北市汐止區
  • 經歷不拘
  • 大學

你渴望在科技浪潮趨勢下,挑戰全球市場,創造新價值,成為卓越的數位 IC 研發工程師嗎? 宏正自動科技作為多電腦切換器KVM全球領導品牌,你將與全球夥伴交流,在國際環境中快速成長! 作為「儲備數位 IC 研發工程師」,你將有專業培訓與指導,深入各式影像介面應用,並參與各項產品規格及系統設計規劃。成為專業的數位 IC 研發工程師,與我們一同開創科技趨勢新局! 【工作內容】 As a IC Design Engineer, you will design, implement and verify products that use FPGAs and/or ASICs. 1. Participate in the micro architecture and design partition within the FPGAs and/or ASICs and implement design blocks using Verilog. 2. Participate in all phases of FPGA/ASIC design Flow (Synthesis, Place & Route, and Timing Closure). 3. Work with SW/HW team members to bring-up and validate FPGAs and/or ASICs. 查看更多資訊: https://www.aten.com/tw/zh/human-resources-hq/ma-bullpen-recruitment/

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11~30人應徵

3/28 韌體設計工程師/硬體研發工程師/FPGA 設計工程師(土城/新竹)

  • 新北市土城區
  • 經歷不拘
  • 大學

1.數位邏輯設計並熟悉RTL Coding架構。 2.熟悉 Xilinx、Altera FPGA 架構與設計。 3.研發設計網通應用IP。 4.協助開發與驗證FPGA電路(Schematic)。

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11~30人應徵

3/28 系統韌體工程師

  • 新北市中和區
  • 6年以上
  • 大學

1.Embedded Linux development experience. 2.Understood video input(MIPI/LVDS) and video output(HDMI/MIPI/LVDS) and image process(mixer/overlap…..) 3.Understood 3D system architecture. 4.加分: Qualcomm/MTK… SoC experience.

待遇面議
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0~5人應徵

3/28 Digital IC Design Engineer 數位IC設計工程師/Manager

  • 台北市內湖區
  • 經歷不拘
  • 碩士

1. RTL design & simulation 2. Cell base design flow 3. Digital verification 4. Design documentation 孰悉以下工具: Verilog coding, 與 Cell base design flow 具有以下相關經驗尤佳: 1. Memory controller 相關經驗 2. low power design flow 相關經驗 3. MCU開發相關經驗 4.FPGA 開發與 SOC整合和驗證

待遇面議 員工20人
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11~30人應徵

3/28 顯示產品軟韌體工程師

  • 新北市中和區
  • 5年以上
  • 大學

1.在Linux平台上,使用C/C++和Java/Javascript語言,實現Smart TV/smart monitor的應用層功能開發。 2.協助第三方模組化軟體的移植,讓我們的產品更具擴展性和可靠性。 3.參與新的智慧型電視功能和OTT應用程式的開發,並為客戶提供客製化方案。 4.使用Java/Javascript語言,進行程式碼整合,確保產品的各個模塊之間穩定運作。 5.利用相關工具(ICE/JTAG等)進行問題的分析和除錯,確保產品的穩定性和可靠性。

待遇面議
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0~5人應徵

3/28 NPU AI晶片系統架構開發資深工程師

  • 台北市士林區
  • 經歷不拘
  • 碩士

英業達近年進攻各種邊緣 AI 運算應用領域,我們是英業達 AI 晶片設計研發團隊,具備多年 AI 與 Processor IC 設計經驗,現正積極投入類神經網路加速器 IP 研發,我們主要工作為應用 Verilog 與 Python,導入來自國際知名 GPU 公司的設計觀念,開發極具競爭力的 AI processor IP,建立完整的Hardware / Software Co-sim 的環境,所有軟硬體皆 in-house 獨立自主研發,2023 年推出已被數家台灣知名上市 IC 設計公司採用,市場需求踴躍,現正積極擴大招募新血,歡迎對 IC 設計、CPU 開發、NPU AI 加速器開發有熱誠的朋友加入!

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11~30人應徵

3/28 數位IC設計工程師 (Digital IC Design Engineer) [Taipei]

  • 台北市中山區
  • 經歷不拘
  • 碩士

【工作職責 (Responsibilities)】: Work with a team to: ★ Plan design architecture. ★ Develop high quality digital design. ★ Be familiar with IC design flow. 【符合條件 (Qualifications)】: 必須條件 (Minimum Qualifications): ★ MS degree in Electrical Engineering, Computer Science or related field. ★ Proficient in Verilog coding and verification. ★ Experienced in front-end IC design flow. 優秀條件 (Preferred Qualifications): ★ Experienced in C language. ★ Experienced in scripting language. ★ Distinguished organizing abilities. ★ Outstanding problem analysis and debugging skills. ★ Optimistic and self-driven personality.

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11~30人應徵

3/28 資深數位IC設計工程師 (Senior Digital IC Design Engineer_ISP and Video Codec) [Hsinchu/Taipei]

  • 台北市中山區
  • 5年以上
  • 碩士

【工作職責 (Responsibilities)】: ★ Plan design architecture. ★ Develop high quality digital design. ★ Be familiar with IC design flow. ★ Professional Experience ★ Experienced in image/video module design ★ Experienced in SoC front-end integration flow ★ In-house core algorithms' module design 【符合條件 (Qualifications)】: 必須條件 (Minimum Qualifications): ★ Experienced in Verilog RTL language ★ Experienced in digital IC design front-end flow ★ Experienced in CAD tool usage such as simulation tool, linting tool, synthesis tool ★ Familiar with video codec algorithm (H.264, H.265, H.266, AV1)

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0~5人應徵

3/28 資深數位IC設計工程師 (Senior Digital IC Design Engineer) [Taipei]

  • 台北市中山區
  • 5年以上
  • 碩士

【工作職責 (Responsibilities)】: ★ ARM series CPU integration ★ System bus architecture design and implementation 【Professional Experience】: ★ Experienced in ARM series CPU integration flow (ARM9, CA7, etc.) ★ Experienced in ARM cache, MMU, TCM design ★ Experienced in system bus architecture (AMBA AHB/AXI) design ★ Experienced in SoC chip integration 【符合條件 (Qualifications)】: 必須條件 (Minimum Qualifications): ★ Outstanding problem analysis and debugging skills. ★ Experienced in Verilog RTL language ★ Experienced in digital IC design front-end flow ★ Experienced in CAD tool usage such as simulation tool, linting tool, synthesis tool, member compiler 優秀條件 (Preferred Qualifications): ★ Nice to have experiences in scripting language. ★ Nice to have experiences in FPGA flow ★ Nice to have experiences in C language.

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0~5人應徵

3/28 數位IC設計工程師(Digital IC Design Engineer)

  • 新北市中和區
  • 3年以上
  • 碩士

1、Digital IC design. Do Verilog coding/Simulation/Synthesis/Verification for Audio/Video/Image SoC 2、具以下經驗者佳: Image processing, USB2/3, Ethernet, HDMI, DDR2, MIPI, Displayport或SOC/Display Controller, MCU/CPU/DSP/SOC bus/Memory controller 3、熟悉 ASIC verification methodology, tools, and development flow.

待遇面議 員工80人
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6~10人應徵

3/28 通訊演算法工程師

  • 新北市中和區
  • 3年以上
  • 碩士

Develop DSP/image processing/communication algorithms for ASIC chips Transform your ideas into algorithms, including: Develop application-specific algorithms in domains such as image processing, quadrature signal processing and DSP filtering. Work with ASIC designers to go through algorithm-to-ASIC implementation.

待遇面議 員工80人
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0~5人應徵

3/28 【研發替代役】Digital Design Engineer(台北)

  • 台北市內湖區
  • 經歷不拘
  • 碩士

-Master/PhD Degree in EE/CS or relevant -Solid knowledge of semiconductor logic design and flow. -Good understanding of video, computer and communications systems is a plus -It is a plus to be familiar with DisplayPort, HDMI, USB and PC Express or other communication protocols

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11~30人應徵

3/28 系統韌體主管

  • 新北市中和區
  • 6年以上
  • 大學

1.Embedded Linux development experience. 2.Linux Camera device driver experience. 3.Understood video input(MIPI/LVDS) and video output(HDMI/MIPI/LVDS) and image process(mixer/overlap…..) 4.Understood UVC/IP Camera and exprience. 5.Understood Multimedia API includes GStreamer/V4L2/DirectShow. 6.加分: Qualcomm/MTK/NXP… SoC experience.

待遇面議
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0~5人應徵

3/28 5G Digital Circuit Designer (土城/新竹)

  • 新北市土城區
  • 經歷不拘
  • 碩士

Responsible for digital circuit development of 5G O-RAN Radio Unit(O-RU) on FPGA/eASIC. O-RU IPs design, clock tree management, processor integration, floor planning and design optimization for timing closure, resource usage and low-power.

待遇面議 上市上櫃
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6~10人應徵
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