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3/29 SOC Physical Design Engineer-台南

  • 台南市永康區
  • 3年以上
  • 大學

1. Responsible for ASIC physical implementation by using automatic place and route tools. The P&R processes including floorplanning, power plan synthesis and analysis, physical timing optimization, clock tree synthesis, routing, and post-routing optimizations. 2. Responsible for physical verification including DRC, LVS and ESD checking.

待遇面議 上市上櫃 員工850人
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6~10人應徵

3/29 SOC Physical Design Manager-台南

  • 台南市永康區
  • 3年以上
  • 大學

1. Responsible for ASIC physical implementation by using automatic place and route tools. The P&R processes including floorplanning, power plan synthesis and analysis, physical timing optimization, clock tree synthesis, routing, and post-routing optimizations. 2. Responsible for physical verification including DRC, LVS and ESD checking.

待遇面議 上市上櫃 員工850人
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0~5人應徵

3/27 Senior Physical Design / APR Engineer / APR Manager(台南)

  • 台南市新市區
  • 5年以上
  • 碩士

Job function: 1. Work with Digital Design team for Physical Design of SoC chips including top level floor planning, block partition, timing budgeting, power planning, block integration, whole chip timing closure, and tape out. 2. Responsible for physical design methodology research and development. 3. Cross site projects coordination and management. Requirement: 1. MS with 5+ years of experience in Physical Design. 2. Familiar with Unix/Linux environment and scripts. 3. Familiar with ASIC design flow. 4. Familiar with Physical Design EDA tools. 5. Good communication and team working skills. 6. Experience in handling large scale SoC chip implementation is a plus.

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6~10人應徵

3/27 SoC實體設計工程師(台南)

  • 台南市新市區
  • 經歷不拘
  • 大學

工作項目: 1. Responsible for ASIC Backend / Physical Implementation, including floorplan, power plan, physical synthesis, clock tree synthesis, routing, si, DFM, DRC/LVS in both hierarchical and low power designs. 2. Responsible for Physical Design flow research, development and automation. 工作地點:南部科學工業園區-台南園區 應徵條件: 1. 大學以上電機資訊相關科系畢 2. 熟悉 IC 後段設計流程, 具相關 APR 經驗者佳. 3. 對於開發及推廣 Physical Design Flow 有興趣者. 4. 熟悉相關 tools(Astro, Encounter, IC Compiler)者尤佳 5. 具程式設計(TCL,Perl,C/C++)能力者佳。

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11~30人應徵

3/27 R-24 IC佈局工程師(台南區)

  • 台南市永康區
  • 1年以上
  • 大學

1.IC fully layout 2.類比 IC Layout 經驗者佳或具APR經驗者。 3.具Tape out 量產經驗,能獨立處理Whole Chip者優先考慮 4.熟悉layout tool或verification tool等工具軟體的使用 5.懂 Latch-up/ESD/Cross-section 者優先考慮

待遇面議 員工600人
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11~30人應徵

3/27 高效能運算(HPC)實體設計資深工程師(台南)T2

  • 台南市新市區
  • 經歷不拘
  • 碩士

工作項目: 1. CPU & GPU Backend Implementation (APR) 2. CPU/GPU Backend Flow Development, Enhancement & Automation 3. Advanced CPU/GPU Technology Development: High-performance, Low Power, and PPA Optimization 應徵條件: 1. 碩士以上;電機、資工、電子相關科系畢業為主。 2. 熟悉 APR Tools (Innovus、ICC2、Fusion Compiler…),有Synthesis、STA/IR Analysis、Physical Verification等相關經驗者佳。 3. 具備程式設計能力,熟悉 TCL/Perl/C++/Python。 4. 有 High Performance CPU/GPU APR經驗尤佳。 5. 個性積極負責、勇於迎接新挑戰,對於 High-Performance CPU/GPU Technology 有興趣者。

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11~30人應徵

2/20 IC佈局工程師

  • 台南市中西區
  • 1年以上
  • 大學

1. 負責IC版圖的佈局佈線、優化和驗證。 2. 負責部分全定製版圖的設計和驗證。 3. 確保IC佈局符合Circuit Designer設計需求及產品、製程、電氣的規範。

待遇面議 員工850人
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0~5人應徵
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