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Memory IP Design Engineer

  • 新竹市
  • 3年以上
  • 大學

Applicant will have Test, design and verification responsibilities for Allegro's internally developed custom memories including SRAM, ROM, One-Time-Programmable, and EEPROM. Responsibilities: - Transistor-level circuit design, simulation, and testing. - Create test/validation plan for different sizes of memories. - Documentation/application note development and customer support.  Job Requirements: BSEE or MSEE with 2+ years' experience with memory design, circuit simulation and testing; knowledge of transistor level circuit design and layout; knowledge of CMOS fabrication methods and digital circuits; experience with layout parasitic extraction and simulation tools; strong written and verbal communication skills; experience with Unix shell languages; understanding of issues and modeling of variation in deep sub-micron technologies; knowledge of verilog modeling; familiarity with layout verification tools, design rules, and rule decks.

待遇面議
0~5人應徵

4/25 SoC數位IC設計工程師

  • 新竹縣竹北市
  • 3年以上
  • 大學

1. ASIC開發數位電路設計,協助客戶制定規格並提供技術協助 2. SoC硬體整合及驗證環境之研發與客戶服務 3.具專案管理能力

待遇面議
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11~30人應徵

4/29 數位IC設計工程師

  • 新竹縣竹北市
  • 經歷不拘
  • 大學

1. Embedded ARM CortexM系列 SOC 實作。 2. AMBA platform architecture design. 3. Constraint scripting for synthesis 4. Equivalency checking 5. UPF scripting 6. Power simulation

待遇面議 員工50人
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11~30人應徵

4/29 數位IC設計工程師

  • 桃園市桃園區
  • 經歷不拘
  • 大學

1. 數位電路設計、驗證與模擬。 2. 熟悉FPGA (XILINX/ALTERA)設計。 3. 影像系統或數位影像處理演算法設計與實現。 ***歡迎應屆畢業生投履歷***

待遇面議
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11~30人應徵

4/29 數位IC設計工程師

  • 台北市內湖區
  • 經歷不拘
  • 大學

1. USB4/DP/HDMI/PCIe controller or high speed development 2. Familiar with Advanced Node Low Power Serial Link and IO/Network Architecture 3. Chip integration, UVM verification, MP testing 4. FPGA High Speed EPHY wrapper or bit file generation from ASIC RTL 我們歡迎有上進心、願意挑戰自我,並持續追求個人和專業成長的個人申請。 *************************************************************************** 如有興趣 若可以請準備個人履歷或相關作品說明 並將個人履歷資料上傳到以下網站 :https://ppt.cc/fPt3lx 檔案命名方式為 履歷檔案-名字-日期 比如 履歷檔案-張大明-2020815 檔案可以包成同一個壓縮檔) 若可以 內容盡量包含 : 1.大學碩士成績單 2.研究或專題論文 3. 其他可加分之書面資料 ***************************************************************************

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6~10人應徵

4/23 (CI10)數位IC設計工程師

  • 新竹縣竹北市
  • 經歷不拘
  • 碩士

【本職缺僅接受新唐科技招募網站投遞】 請至新唐科技招募網站投遞個人履歷表,此職缺履歷登錄網址:https://jobs.nuvoton.com/ 數位晶片開發設計 1. 熟悉 8051/CR16/ARM Cortex M 系統架構 2. 電腦週

待遇面議 員工1500人
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11~30人應徵

4/23 資深數位IC設計工程師

  • 台北市內湖區
  • 5年以上
  • 碩士

(1) 研讀專案相關規格書,然後對於專案所需要的功能進行RTL code設計。 (2) 對於該功能RTL code進行模擬與各項確認驗證。 (3) 對於整體ASIC進行FPGA系統驗證。 (4) 產生邏輯元件檔案並且做相關之時序檢驗與確認。

待遇面議 員工72人
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0~5人應徵
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