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Memory IP Design Engineer

美商朗格股份有限公司台灣分公司

新竹市

3年以上

大學

Applicant will have Test, design and verification responsibilities for Allegro's internally developed custom memories including SRAM, ROM, One-Time-Programmable, and EEPROM. Responsibilities: - Transistor-level circuit design, simulation, and testing. - Create test/validation plan for different sizes of memories. - Documentation/application note development and customer support.  Job Requirements: BSEE or MSEE with 2+ years' experience with memory design, circuit simulation and testing; knowledge of transistor level circuit design and layout; knowledge of CMOS fabrication methods and digital circuits; experience with layout parasitic extraction and simulation tools; strong written and verbal communication skills; experience with Unix shell languages; understanding of issues and modeling of variation in deep sub-micron technologies; knowledge of verilog modeling; familiarity with layout verification tools, design rules, and rule decks.

11~30人應徵

RF韌體設計資深工程師@新竹_04160005

乾坤科技股份有限公司_台達電子集團

新竹市

經歷不拘

大學

1. Xilinx FPGA 相關專案開發 2. 射頻晶片數位控制開發 3. FPGA與SPI及I2C相關應用【Preference】： 1. 熟悉Xilinx開發平台 2. 毫米波天線模組數位控制開發 3. 熟悉周邊介面(I2C, SPI,GPIO,UART)與各式高速介面(Ethernet, Memory control etc…) 4. 協同跨部門工程單位，軟硬體整合優化 5. 通訊相關背景佳

11~30人應徵

4/30 軟體研發類: Software RD (熟習Verilog/VCS) (新竹)

Synopsys Taiwan Co., Ltd._台灣新思科技股份有限公司

電腦軟體服務業

新竹市

5年以上

大學

Signal Verification solution development typically needs to work with experts from different areas (Verilog simulator, SPICE

0~5人應徵

5/02 IO/Verilog Characterization and Modeling Engineer (Hsinchu) (3060881)

Qualcomm Semiconductor Corporation_高通半導體有限公司

IC設計相關業

新竹市

4年以上

大學

This is a Verilog modeling and characterization engineer position in Methodology, Flow and Design Kit team involved in

0~5人應徵

5/02 FPGA design engineer

富宇翔科技股份有限公司

通訊機械器材相關業

台北市內湖區

經歷不拘

碩士

layer. 3、Study related specification. 4、Develop in verilog language. 5、Use Matlab for verification. 6、Use Xilinx Vitis tool

6~10人應徵

5/07 研發類-- DRAM Verilog IC設計工程師(竹北)

華邦電子股份有限公司

IC設計相關業

新竹縣竹北市

2年以上

碩士

【邀請您將104履歷同步上傳至華邦官方網站，將使您的履歷優先被主管看見】此職缺履歷登錄網址：https://bit.ly/3VbIz0v 1. DRAM Verilog /VCS/Modelsim behavior models

11~30人應徵

5/06 NPU AI晶片系統架構開發資深工程師

Inventec_英業達股份有限公司

電腦及其週邊設備製造業

台北市士林區

經歷不拘

碩士

英業達近年進攻各種邊緣 AI 運算應用領域，我們是英業達 AI 晶片設計研發團隊，具備多年 AI 與 Processor IC 設計經驗，現正積極投入類神經網路加速器 IP 研發，我們主要工作為應用 Verilog 與 Python，導入來自國際

6~10人應徵

5/06 數位IC驗證工程師

智微科技股份有限公司

半導體製造業

新竹縣寶山鄉

2年以上

大學

JMicron, founded in 2001 and located in Hsinchu Science Park, is a leading provider for high speed SerDes bridge controller SOC's mainly in storage application utilizing USB, PCIe, and SATA. With recent merger of KaiKuTek, our product portfolio now extends to 3D mmWave smart sensor for gesture recognition and AIoT markets. We now possess key technologies in areas such as Antenna-in-Package (AiP), ML algorithm, AI accelerator, as well as 60 GHz radar transceiver design. This new sensing technology will change and redefine human-machine interface as we know today, and mmWave technology combined with high speed SerDes will open door to many new possibilities and application frontiers. JMicron is looking for enthusiastic digital IC design engineers willing to take upon new challenges of working closely with cross functional teams, including analog/RFIC designers, hardware engineers, software and firmware engineers, production and testing as well as marketing and FAE, to optimize the overall SoC performance in terms of power, area, functionality, testability as well as to create proof-of-concept for new customer engagement.

6~10人應徵

10/19 數位IC工程師 (FPGA)(台北/新竹)

雷捷電子股份有限公司

IC設計相關業

新竹縣竹北市

2年以上

碩士

雷達數位IC FPGA Prototyping 硬體部門合作 FPGA daughter board 演算法部門合作撰寫 Verilog 韌體部門合作驗證 FPGA

6~10人應徵

4/16 ASIC Design Verification Engineer

英屬開曼群島商愛康科技股份有限公司台灣分公司

IC設計相關業

新竹縣竹北市

10年以上

大學

Provide design verification services for our SoC ※ Responsibilities: • Test bench development using System Verilog

0~5人應徵

4/25 Verification Engineer

創惟科技股份有限公司

IC設計相關業

新北市新店區

經歷不拘

碩士

Digital design verification using UVM and System Verilog.

11~30人應徵

5/07 【派駐聯發科】IC數位設計驗證工程師

才庫人力資源顧問股份有限公司

人力仲介代徵

新竹市

經歷不拘

大學

1. 定期執行大量simulation, 網頁成功失敗機率做成圖，反覆驗證檢查結果 2. 使用大數據分析網頁, 產出報告 3. 開發自動化程式福利：有年終，餐費補助，有員工旅遊補助，有三節獎金(或等值禮卷)

0~5人應徵

5/09 FPGA高級工程師_12946

和碩集團_和碩聯合科技股份有限公司

電腦及其週邊設備製造業

台北市北投區

經歷不拘

碩士

- 負責開發與設計相控陣列/光達/雷達硬體。 - 開發FPGA/CPLD 相關專案與Verilog/VHDL程式設計。 - 客製化高速 I2C, SPI, MIPI, UART, and Ethernet等IP。 - 進行FPGA/CPLD專案可

11~30人應徵

4/24 數位IC設計工程師 (台北/新竹)(研發替代役可)

超象科技股份有限公司

半導體製造業

新北市新店區

經歷不拘

大學

1. 邏輯清楚、富創造性。 2. 熟悉FPGA。 3. 熟悉Verilog.

11~30人應徵

3/21 數位IC設計工程師(新竹/台北)

安格科技股份有限公司

其他半導體相關業

新竹縣竹北市

3年以上

碩士

【工作內容】 1. IP介面控制和時序處理 2. 晶片上層連線和系統整合 3. 使用Verilog設計和功能模擬 4. 使用FPGA進行功能驗證 5. 晶片合成並完成DFT, multi-clock和timing等設計 6. 與後段整合合作, 完

6~10人應徵

5/03 【IT】數位設計驗證工程師(新竹)(新竹科學園區)

智聯服務股份有限公司

電腦系統整合服務業

新竹市

經歷不拘

碩士

[駐點於知名科技公司服務] 1. 定期執行大量simulation, 分析結果 2. 使用大數據分析網頁, 產出報告 3. 開發自動化程式 4. Testbench 維護和開發

0~5人應徵

5/03 CPU Synthesis Engineer

晶心科技股份有限公司

IC設計相關業

新竹市

經歷不拘

大學

 Improve synthesis constraints  Work with RTL designers to enhance dynamic power Qualifications  Familiar with Verilog

11~30人應徵

5/03 數位IC設計工程師-ASIC工程師

翊傑科技股份有限公司

IC設計相關業

新竹市

3年以上

大學

職務說明 1.3+ years experiences in ASIC/SOC IC design, sample verification 2.Experience on RTL / Verilog design, synthesize,

0~5人應徵

10/16 FPGA Design Engineer

智成電子股份有限公司

半導體製造業

新竹市

經歷不拘

大學

1.In charge of digital circuit design/verify by Verilog 2.Implement FPGA development & architecture. 3.Familiar with Xilinx

11~30人應徵

5/09 【2024研發替代役】SoC Design Engineer/SoC設計工程師

擷發科技股份有限公司

其他電子零組件相關業

新竹市

經歷不拘

大學

1.Complete the front-end design tasks from RTL design to netlist 2.Main jobs contains spec study, architecture plan, RTL coding, simulation, debugging, Lint, CDC, synthesis, LEC, SDC, and STA 3.Support other functional teams (such as IP ,DFT , and P&R vendor) to deliver an SoC/ASIC design 4. Porting RTL Code to FPGA Platform 1.負責RTL到netlist前端設計 2.規格研讀,架構設計規劃, RTL 撰寫,模擬等工作 3.與廠商合作完成SoC/ASIC設計 4.移植RTL 編碼到FPGA平台

11~30人應徵

5/09 MATLAB 應用工程師 (通訊演算法開發/FPGA )

鈦思科技股份有限公司

電腦軟體服務業

新竹縣竹北市

經歷不拘

碩士

具有通訊系統設計背景，且熟悉FPGA為佳。工作內容： 1. Work directly with customers to provide technical assistance and establish deployment strategies for MATLAB/Simulink. 2. Provide technical advice on how to realize them with MATLAB/Simulink. 3. Work closely with sales teams and other customer-facing staff focused on a fast paced and continually evolving strategy for successful adoption of tools for deployments.

6~10人應徵

4/17 數位電路設計工程師

安沛科技股份有限公司

其他電子零組件相關業

新竹縣竹北市

3年以上

碩士

Logic architecture design Algorithm design SoC design (MCU&Peripheral design) VHDL/Verilog logic design & simulation

0~5人應徵

載入第1頁

Memory IP Design Engineer

RF韌體設計資深工程師@新竹_04160005

4/30 軟體研發類: Software RD (熟習Verilog/VCS) (新竹)

5/02 IO/Verilog Characterization and Modeling Engineer (Hsinchu) (3060881)

5/02 FPGA design engineer

5/07 研發類-- DRAM Verilog IC設計工程師(竹北)

5/06 NPU AI晶片系統架構開發資深工程師

5/06 數位IC驗證工程師

10/19 數位IC工程師 (FPGA)(台北/新竹)

4/16 ASIC Design Verification Engineer

4/25 Verification Engineer

5/07 【派駐聯發科】IC數位設計驗證工程師

5/09 FPGA高級工程師_12946

4/24 數位IC設計工程師 (台北/新竹)(研發替代役可)

3/21 數位IC設計工程師(新竹/台北)

5/03 【IT】數位設計驗證工程師(新竹)(新竹科學園區)

5/03 CPU Synthesis Engineer

5/03 數位IC設計工程師-ASIC工程師

10/16 FPGA Design Engineer

5/09 【2024研發替代役】SoC Design Engineer/SoC設計工程師

5/09 MATLAB 應用工程師 (通訊演算法開發/FPGA )

4/17 數位電路設計工程師

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