找頭鹿 智能客服
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公司介紹
產業描述
IC設計相關業
電話
03-6663150
員工人數
46人
地址
新竹縣竹北市環科一路23號9樓之1 (昌益科技產發園區)
公司簡介
上峰科技於2010年成立，專注於單次可燒錄記憶體(OTP)矽智財的研發，以創新技術在IC設計產業中獨占先機。公司的OTP技術不僅業界獨創，擁有超過90項專利認證，更通過多家世界級大廠的嚴格驗證，其可靠性遠勝競爭對手。 上峰科技的研發團隊擁有豐富的半導體研發經驗和多項專利技術，致力於打造出最切合客戶需求的OTP矽智財解決方案。 公司秉持「著眼國際、根留台灣」的經營理念，強調對台灣半導體產業的技術創新和發展的承諾。這份承諾於2024年獲得台灣金根獎的肯定，是對公司創新技術和對產業的重要貢獻的認可。 在上峰科技，每一位員工都被視為公司最寶貴的資產。透過扁平化的管理制度，我們提供員工更大的發揮空間和表達意見的機會。同時，公司注重提供豐富的員工福利，期許員工和公司共同茁壯成長。 我們熱切歡迎充滿活力和創造力的卓越人才加入上峰科技，這裡不僅能享受優渥的薪資和福利，更能充分展現潛能。期待您的加入，與上峰科技攜手共創未來，共同體驗自我實現的喜悅。
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主要商品 / 服務項目
本公司主要產品為矽智財中的熔絲(fuse)架構單次可燒錄記憶體(OTP)矽智財。單次可燒錄記憶體矽智財(OTP IP)之應用極廣，適用於車用領域、物聯網、電源管理、生物識別傳感器等多個領域，主要功能包括資料儲存、安全碼設定以及電路調整等。 本公司研發之I-fuse® OTP技術屬於業界獨創，因其特殊的燒錄機制，使其不同於業界既有的OTP技術，僅需低電壓即可進行燒錄、讀取，且具備小尺寸、高可靠度等領先業界之優勢。 可至公司官網了解更多產品資訊: http://www.attopsemi.com
公司環境照片(7張)
辦公室空間
員工休憩區
會議空間
榮獲 「台灣金根獎」，為根留台灣、全球佈局經營典範企業
內部訓練
Team Building Activity
Team Building Activity
福利制度
法定項目
其他福利
★【薪酬福利】★ ◎員工認股權 ◎年終獎金 ◎績效獎金 ◎壽星生日禮金 、端午中秋禮品 ◎婚喪喜慶及生育補助(結婚禮金/生育津貼/傷病住院津貼) ★ 【扎實的訓練】★ ◎新進人員、核心職能、專業職能、派外等訓練 ◎透過在職訓練、派外訓練、線上課程等途徑讓員工獲得適當的培育 ◎分享精神的內訓，前輩以分享為始傳遞經驗，深獲同仁讚譽與踴躍出席的反饋 ★【完善貼心的福利】★ ◎優於法令之彈性休假。 ◎保險保障：員工意外傷害住院團保 ◎健康檢查：定期提供免費健康檢查 ★ 【友善的職場環境】★ ◎自主管理，彈性上下班。 ◎寬敞乾淨的辦公環境 。 ◎咖啡同好分享。 ◎免費零食補給站 ◎部門聚餐補助 ★ 【多元的促進員工關係活動】★ ◎不定期舉行工作與生活的平衡活動
公司發展歷程
2024.01
上峰科技獲頒台灣產業科技推動協會(TITA)之金根獎，是”根留台灣、全球佈局”的典範企業。
2023.04
I-fuse® OTP技術通過12奈米FinFET製程矽驗證 上峰科技與日本tier-1汽車元件供應商Denso合作，正式跨入車用市場
2022.05
上峰科技與X-FAB合作於XH018製程平台成功導入創新OTP I-fuse S3架構
2020.05
上峰科技通過ISO9001:2015品質管理認證
2019.09
上峰科技榮獲中國IP SoC最佳創新IP獎、獲選經濟部小型企業創新研發計畫補助
2018.10
上峰科技創辦人莊建祥先生受邀在第六屆FD-SOI論壇的AloT發表演講，使台灣獨創技術躍上國際舞台
2017.10
上峰科技在舊金山IEEE SOI-3D-微電子技術統一會議（S3S）上發表了〈22nm FD SOI中的32Kb創新熔絲(I-fuse®)陣列〉論文
2016.05
上峰科技在日本微電子測試結構國際會議（ICMTS）上發表了〈可從0.35um到28nm的超小且超可靠的熔絲OTP技術〉論文
2015.03
上峰科技與領先晶圓廠世界先進簽署單次可燒錄記憶體(One Time Programmable)IP授權合約
2013.10
上峰科技獲頒亞洲育成協會(AABI) 的火炬獎
2010.06
上峰科技股份有限公司成立
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工作機會
9/24
• Circuit design of One-Time Programmable (OTP) IPs in state of art process technologies for commercial, automotive and industrial applications
• Leading & working within design team with full IP and technology ownership and responsibilities, from bit cell development to IP design and release
• Supervision of layout activities in all blocks, optimization of circuit performance, area and power.
• Collaborating with test engineers and product engineers to expedite silicon evaluation process
• Working closely with Sales & CE (Customer Engineer) in promotion of company’s OTP IPs, and in fulfilling the need of (existing and prospective) customers
1. NVM (Non-Volatile Memory) 電路開發設計
2. NVM週邊類比電路開發設計與佈局優化
3. NVM電路整合開發設計
4. 協助NVM測試晶片驗證、偵錯
5. OTP IP 之專案負責人，偕同公司之銷售代表及客戶工程師，協助客戶嵌入使用以及導入量產NVM IP產品
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