數位IC設計工程師(新竹)

09/26更新

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應徵

應徵人數 11~30 人

工作內容

【工作內容】 1. IP介面控制和時序處理 2. 晶片上層連線和系統整合 3. 使用Verilog設計和功能模擬 4. 使用FPGA進行功能驗證 5. 晶片合成並完成DFT, multi-clock和timing等設計 6. 與後段整合合作, 完成晶片驗證並T/O 【需求條件】 1. 碩士畢業，數位IC設計3年以上經驗 2. 熟悉ASIC設計和開發流程 3. 熟悉Verilog, Synthesis, formal, STA, FPGA驗證等流程 4. 熟悉上層整合和IP介面 5. 具有T/O量產經驗者佳 6. 具有low power和UPF設計經驗者佳

職務類別

工作待遇

待遇面議

（經常性薪資達 4 萬元或以上）

工作性質

全職

上班地點

新竹縣竹北市高鐵二路55號

遠端工作

管理責任

不需負擔管理責任

出差外派

無需出差外派

上班時段

日班

休假制度

週休二日

可上班日

不限

需求人數

1~2人

條件要求

工作經歷

3年以上

學歷要求

碩士以上

科系要求

不拘

語文條件

不拘

擅長工具

FPGA、Verilog

工作技能

數位電路分析設計

其他條件

1. 熟悉ASIC設計和開發流程 2. 熟悉Verilog, Synthesis, formal, STA, FPGA驗證等流程 3. 熟悉上層整合和IP介面 4. 具有T/O量產經驗者佳 5. 具有low power和UPF設計經驗者佳

歡迎所有求職者，與

應屆畢業生

等

福利制度

法定項目

哺乳室週休二日員工體檢

其他福利

年終獎金三節獎金/禮品零食櫃咖啡吧健身器材員工舒壓按摩社團補助國內旅遊部門聚餐慶生會社團活動健身房優於勞基法特休員工團體保險不用補班

◆薪資有保障◆ 三節獎金年度調薪員工分紅，與公司共享營運成果員工認股權制度/成立員工福利持股會，一起參與公司經營與成長 ◆玩樂無極限◆ 優於勞基法之特休制度，每年額外提供彈性休假定期舉辦員工旅遊活動，適時放鬆員工身心靈定期聚餐和慶生活動年度尾牙活動成立各式社團，鼓勵員工共同培養興趣特約健身房，建立運動好習慣 ◆無後顧之憂◆ 彈性上下班制度除勞保、健保，另享員工團保，讓員工有更好之醫療品質與保障免費年度健檢，了解自身健康情形提供婚、喪、喜、慶之慰問金 ◆共同成長茁壯◆ 提供外訓課程補助，鼓勵每位員工切實追求自我學習和成長建立暢通與開放的多元化溝通管道，讓員工更能參與公司發展規劃實施管理與專業職能雙重晉升管道，以期適才適所

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