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工作內容
• Work on 22nm~6nm design implementation, methodology, and sign-off • Perform floorplan, power plan, place and route, timing closure, ECO • Requirement: - Hands on whole chip APR physical design from netlist to DRC/LVS tapeout - Familiar with Cadence Innovus & Synopsys ICC/ICC2 experience is required
職務類別
IC佈局工程師
認識IC佈局工程師職務 工作待遇
待遇面議
（經常性薪資達 4 萬元或以上）
工作性質
全職
管理責任
不需負擔管理責任
出差外派
無需出差外派
上班時段
日班
休假制度
週休二日
可上班日
不限
需求人數
1人
條件要求
工作經歷
2年以上
學歷要求
大學、碩士
科系要求
電機電子工程相關、資訊工程相關
語文條件
不拘
擅長工具
不拘
工作技能
不拘
其他條件
- Familiar with the DDR/NPU/SERDES are a plus. - Familiar with EDA tools and flow methodologies are a plus. - Familiar with the complex ASIC design process/Low power design is a plus. - Familiar with STA check and timing closure is plus. - Familiar with Physical Synthesis is a plus.
福利制度
達發科技將人才視為公司最大的資產，對於員工的照顧不遺餘力，我們的福利制度優於同業，包含: 1. 勞保、健保、團保、退休金提撥及定期年度健檢。 2. 員工用餐補助、定期下午茶等多項生活福利。 3. 旅遊補助、生日禮金、婚喪喜慶補助、生育補助...等數種員工福利方案。 4. 年度教育訓練計畫、教育訓練補助，鼓勵同仁學習成長。 5. 週休二日，彈性上下班。 6. 提供優於法令之彈性休假，讓同仁自行安排運用。
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HR
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