FPGA/CPLD 工程師

10/01更新

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應徵

應徵人數 0~5 人

工作內容

1. 主FPGA與CPLD專案開發與維護 2. 熟RTL coding, 具Xilinx ISE/Vivado或Altera Quartus II專案設計經驗 3. 能與軟,韌,硬體等相關部門co-work 4. 具Xilinx PCIe 與 MIG DDR3/4系統整合經驗者佳

職務類別

、

工作待遇

待遇面議

（經常性薪資達 4 萬元或以上）

工作性質

全職

上班地點

桃園市龜山區文茂路88號9樓

遠端工作

管理責任

不需負擔管理責任

出差外派

無需出差外派

上班時段

日班，09:00~18:00

休假制度

週休二日

可上班日

不限

需求人數

1人

條件要求

工作經歷

2年以上

學歷要求

大學以上

科系要求

工程學科類、數學及電算機科學學科類

語文條件

英文 -- 聽 /略懂、說 /略懂、讀 /中等、寫 /中等

擅長工具

CPLD、FPGA、RTL、Verilog、VHDL

工作技能

撰寫硬體語言程式、基礎數位電路、數位晶片產品開發、數位電路分析設計、數位電路驗證

其他條件

公司環境照片(3張)

致茂集團_匯宏科技股份有限公司環境照

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福利制度

享勞健保,團保員工結婚、生育、喪葬補助勞動節、三節禮金週休二日員工退休金, 勞退新制自助式員工餐廳，提供多樣化餐飲服務員工休閒中心：多功能的健身房、2溫水游泳池、SPA池、蒸氣室等空間，讓同仁們能就近鍛鍊身體，擁有舒展身心、解放壓力

聯絡方式

聯絡人

林小姐

E-mail

[email protected],[email protected]

電洽

03-3279968-89989

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